Category:NAND gates
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Subkategorioj
Ĉi tiu kategorio havas la 38 jenajn subkategoriojn, el 38 entute.
4
- 4011 (CMOS) (32 D)
- 4012 (CMOS) (6 D)
- 4023 (CMOS) (9 D)
- 4068 (CMOS) (2 D)
- 4093 (CMOS) (5 D)
7
C
- CMOS NAND gates (13 D)
D
- DTL NAND gates (7 D)
N
- NMOS NAND gates (6 D)
S
- NAND gate symbols (57 D)
T
- TTL NAND gates (13 D)
Dosieroj en kategorio “NAND gates”
La jenaj 85 dosieroj estas en ĉi tiu kategorio, el 85 entute.
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155ЛА18 Планета.jpg 719 × 524; 108 KB
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2. Teorema.png 620 × 166; 5 KB
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2. Theorem.svg 512 × 91; 1 KB
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2014-01-15 08-38-50 electronique-site-plutons porte-logique.jpg 3 465 × 1 320; 1,92 MB
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3 NAND gates with 2 variables.svg 300 × 160; 5 KB
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3И-НЕ 74LS(К555).JPG 236 × 195; 21 KB
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3И-НЕ 74LS(К555).svg 642 × 520; 29 KB
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4phase.jpg 583 × 268; 39 KB
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7400 Circuit.svg 319 × 372; 34 KB
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74LS00 Circuit.svg 319 × 372; 35 KB
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74LS00 Übertragungskennlinie.svg 340 × 283; 9 KB
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AND by NAND jp.svg 700 × 100; 14 KB
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And feito com a porta NAND.jpg 729 × 279; 35 KB
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Bascule JK.svg 512 × 361; 25 KB
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CMOS NAND Layout2-ru.svg 297 × 585; 19 KB
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Constructing NAND gate from NOR gates.png 258 × 127; 3 KB
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Constructing NOR gate from NAND gates.png 258 × 127; 3 KB
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Contact-nand.png 226 × 74; 2 KB
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CPU NAND2.PNG 400 × 250; 6 KB
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Crossover nand svg.svg 478 × 230; 38 KB
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Crossover nand.pdf 795 × 383; 22 KB
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DeMorgan Logic Circuit diagram DIN.svg 1 300 × 900; 14 KB
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Digitale Kreuzschaltung 1.png 1 100 × 1 400; 40 KB
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Dlnand.svg 801 × 1 173; 11 KB
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FWE U107D.jpg 1 800 × 1 660; 215 KB
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High Threshold Logic circuit diagram.jpg 525 × 416; 35 KB
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IMPLY gate NAND.png 291 × 120; 4 KB
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Impulse NAND.svg 1 100 × 900; 7 KB
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Inversor feito com a porta NAND.jpg 678 × 313; 33 KB
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ISO-RS-FF-NAND-with-clock.png 882 × 600; 8 KB
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ISO-RS-FF-NAND-with-clock.svg 347 × 174; 17 KB
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JK-FlipFlop (4-NAND).PNG 900 × 500; 32 KB
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Logik-nand.svg 347 × 222; 12 KB
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Logische Verknuepfung NAND.svg 2 000 × 1 200; 87 KB
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MC849 Circuit.svg 337 × 351; 31 KB
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MFrey Not A NAnd Not B.svg 150 × 80; 17 KB
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MFrey Task 1 Solution NAND 2 Input.svg 640 × 480; 62 KB
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MFrey Task 1 Solution NAND-small.svg 300 × 300; 51 KB
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MFrey Task 1 Solution NAND.svg 640 × 480; 53 KB
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NAND ANSI.svg 100 × 50; 481 bajtoj
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NAND en schéma électrique.svg 326 × 102; 8 KB
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NAND from NOR.svg 280 × 100; 20 KB
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NAND Gated SR Latch.png 1 280 × 771; 42 KB
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NAND logic circuit jp.svg 400 × 100; 15 KB
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NAND-poort kontakt equivalent.png 218 × 91; 670 bajtoj
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NAND-poort relais.png 218 × 194; 2 KB
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NAND-switch-2.png 800 × 534; 22 KB
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NAND-switch.PNG 190 × 129; 2 KB
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NOR from NAND.svg 280 × 100; 22 KB
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NOR NAND.PNG 175 × 69; 1 KB
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NOT by NAND jp.svg 450 × 100; 10 KB
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OR by NAND jp.svg 700 × 200; 19 KB
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Or feito com a porta NAND.jpg 737 × 360; 45 KB
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OR from NAND.svg 200 × 100; 19 KB
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OU-exclusif-nand.png 1 257 × 689; 2 KB
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Phase detectors.svg 531 × 478; 135 KB
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PMOS NOR corr.png 89 × 167; 1 KB
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PMOS-NAND-gate.svg 461 × 673; 24 KB
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Puerta lógica NAND biología sintética.png 1 065 × 236; 72 KB
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Puerta NAND con transistores.jpg 299 × 387; 8 KB
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Relay nand.svg 200 × 150; 11 KB
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RS-FF-in-NAND.png 600 × 643; 5 KB
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RTL npn nand.png 234 × 205; 3 KB
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Schema NAND poort.jpg 886 × 372; 55 KB
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Simplified NAND gate circuit using 2 transistors.svg 320 × 420; 6 KB
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Skakelaar NAND.jpg 170 × 107; 3 KB
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SR Flip-flop Diagram.svg 200 × 125; 18 KB
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SR Latch with 4NANDs.svg 294 × 177; 24 KB
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Switch NAND.jpg 170 × 107; 4 KB
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Switch NAND.svg 283 × 142; 2 KB
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SynBioCirc-NandLogicGate.jpg 1 065 × 236; 112 KB
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Tabela Verdade Porta NAND.jpg 126 × 173; 9 KB
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Transistor fault in a CMOS NAND gate.png 551 × 592; 19 KB
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TTL npn nand.png 241 × 220; 4 KB
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Tungsram 75450APC.jpg 2 307 × 1 181; 1,1 MB
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USpatent3356858 fig6.png 1 208 × 993; 87 KB
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Venn-NAND-static.png 1 032 × 396; 195 KB
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Venn-NAND.gif 480 × 304; 4,84 MB
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XNOR from NAND 2.svg 320 × 150; 14 KB
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XNOR from NAND.svg 380 × 100; 25 KB
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XOR from NAND 2.svg 330 × 150; 14 KB
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XOR from NAND.svg 300 × 100; 22 KB
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XOR Using NAND.jpg 303 × 120; 31 KB
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XOR using NAND.svg 248 × 76; 14 KB