File:4006 chronogramme 1.png
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Légendes
Légendes
Chronogrammes du premier registre à décalage du circuit CMOS 4006 - principe et exemple.
Description
[modifier]Description4006 chronogramme 1.png |
Français : En haut, le chronogramme exposant le principe de fonctionnement du premier registre à décalage du circuit CMOS 4006 et de sa sortie latchée. Les valeurs logiques a, b, c et d correspondent aux états initiaux des bascules du registre. Les valeurs logiques e, f, g, h, i, j et k correspondent aux états présents sur l'entrée du registre lors des fronts descendant successifs de l'horloge CLOCK. En bas, un exemple de signaux logiques obtenus. |
Date | |
Source | Travail personnel |
Auteur | PA5CAL France |
Conditions d’utilisation
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Date et heure | Vignette | Dimensions | Utilisateur | Commentaire | |
---|---|---|---|---|---|
actuel | 15 mai 2022 à 21:32 | ![]() | 800 × 780 (44 kio) | PA5CAL France (d | contributions) | Uploaded own work with UploadWizard |
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Données structurées
Éléments décrits dans ce fichier
dépeint
Valeur sans élément de Wikidata
15 mai 2022
image/png
0c99b719571e989ff7a06273e6ab6048ac43db54
45 110 octet
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