File:NOR gate layout.png
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NOR_gate_layout.png (600 × 433 píxeles; tamaño de archivo: 22 kB; tipo MIME: image/png)
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Resumen[editar]
DescripciónNOR gate layout.png |
Shows a CMOS implementation of a NOR gate. Also used at http://www.sccs.swarthmore.edu/users/06/adem/engin/e77vlsi/lab3/ |
Fecha | 20 de noviembre de 2009 (fecha original de carga) |
Fuente | No se ha podido leer automáticamente información sobre la fuente; se asume que es trabajo propio (según los derechos de autor reclamados). |
Autor | No se ha podido leer automáticamente información sobre el autor; se asume que es Miquel puig (según los derechos de autor reclamados). |
Licencia[editar]
Public domainPublic domainfalsefalse |
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Fecha y hora | Miniatura | Dimensiones | Usuario | Comentario | |
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actual | 12:41 20 nov 2009 | 600 × 433 (22 kB) | Miquel puig (discusión | contribs.) | == Summary == Shows a CMOS implementation of a NOR gate. Also used at http://www.sccs.swarthmore.edu/users/06/adem/engin/e77vlsi/lab3/ == Licensing == {{PD-self|date=November 2007}} Category:Logic Category:Logic gates |
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