File:MIPS Architecture (Pipelined).svg
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Datos estructurados
Leyendas
DescripciónMIPS Architecture (Pipelined).svg |
English: The stage-by-stage architecture of a MIPS microprocessor with a pipeline. Although the memory is shown twice for clarity of the pipeline, MIPS architectures have only one memory bank (i.e. von Neumann architecture). |
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Fecha | ||||
Fuente | Trabajo propio | |||
Autor | Inductiveload | |||
Permiso (Reutilización de este archivo) |
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Otras versiones | rkrkgkf |
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Fecha y hora | Miniatura | Dimensiones | Usuario | Comentario | |
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actual | 17:08 22 ene 2009 | 800 × 500 (56 kB) | Inductiveload (discusión | contribs.) | {{Information |Description={{en|1=The stage-by-stage architecture of a MIPS microprocessor with a pipeline. Although the memory is shown twice for clarity of the pipeline, MIPS architectures have only one memory bank (i.e. von Neumann architecture).}} |So | |
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Anchura | 800 |
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