File:MIPS Architecture (Pipelined).svg
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Informations sur le fichier
Données structurées
Légendes
Description
[modifier]DescriptionMIPS Architecture (Pipelined).svg |
English: The stage-by-stage architecture of a MIPS microprocessor with a pipeline. Although the memory is shown twice for clarity of the pipeline, MIPS architectures have only one memory bank (i.e. von Neumann architecture). |
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Date | ||||
Source | Travail personnel | |||
Auteur | Inductiveload | |||
Autorisation (Réutilisation de ce fichier) |
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Autres versions | rkrkgkf | |||
SVG information InfoField | Le code de ce fichier SVG n'est pas valide en raison d'une erreur. Cette image vectorielle SVG W3C-invalide a été créée avec Inkscape. |
Historique du fichier
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Date et heure | Vignette | Dimensions | Utilisateur | Commentaire | |
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actuel | 22 janvier 2009 à 17:08 | 800 × 500 (56 kio) | Inductiveload (d | contributions) | {{Information |Description={{en|1=The stage-by-stage architecture of a MIPS microprocessor with a pipeline. Although the memory is shown twice for clarity of the pipeline, MIPS architectures have only one memory bank (i.e. von Neumann architecture).}} |So | |
22 janvier 2009 à 17:08 | 800 × 500 (56 kio) | Inductiveload (d | contributions) | {{Information |Description={{en|1=The stage-by-stage architecture of a MIPS microprocessor with a pipeline. Although the memory is shown twice for clarity of the pipeline, MIPS architectures have only one memory bank (i.e. von Neumann architecture).}} |So |
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Largeur | 800 |
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Hauteur | 500 |